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Ein erster Versuch soll analysiert werden:
Vervollständigen Sie das Timig-Diagramm, Das Timing kann mit Logiflash überprüft werden. |
Welche Erkenntnisse konnten gewonnen werden?
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Ein zweiter Versuch soll analysiert werden:
Vervollständigen Sie das Timig-Diagramm, Das Timing kann mit Logiflash überprüft werden. |
Welche Erkenntnisse konnten gewonnen werden?
Erklärung | JK-Master Slave FF | entspricht | neg. flanken getriggertem T-FF |
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Im Digital-Experimenter werden universelle JK-Master-Slave FF verwendet.
Aus diesen FF lassen sich durch entsprechende Beschaltung Lässt man J und K unbeschaltet (entspricht hier log. 1) |
= |
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Also verdrahte man Q nach C1 für einen pos. Zähler! |
Entwickeln Sie einen Zähler von 0 bis 7 mit Anzeige über 7-Segment und zeichnen Sie die Verdrahtung für den Zähler ein.
Entwickeln Sie den Zähler mit Logiflash mit T-FF und dokumentieren Sie das Timing-Diagramm mit der Oszilloskop-Funktion.
Tipp: Verwenden Sie die einfache 7-Segmentanzeige |
Entwickeln Sie mit Digital-Experimenter einen Zähler von 0 bis 5 (modulo 6 Zähler) mit Anzeige über 7-Segment, zeichnen Sie einen Schaltplan.
Entwickeln Sie mit Digital-Simulator einen Zähler von 0 bis 5 (modulo 6 Zähler) mit Anzeige über 7-Segment. Verwenden Sie D-FF mit !S und !R Eingang. Wichtig: Der !S Eingang muss auf VCC gelegt werden! Dokumentieren Sie das Timing-Diagramm mit der Oszilloskop-Funktion. |